diff --git a/labor_4/README.md b/labor_4/README.md
index ab0cb01..1c2e14c 100644
--- a/labor_4/README.md
+++ b/labor_4/README.md
@@ -22,12 +22,16 @@ Aufgabenstellung aus der Email:
     - Wenn das Zählerregister 0 ist soll außerdem der Ausgang SYNC auf 1 gesetzt werden.
 
 
-Eingänge:
+**Eingänge:**
+
 CLK:            Taktsignal
+
 RESETn:         Asynchroner, 0-aktiver Reset, setzt alle Bits im Zählerregister auf 0
+
 CLOCK_DIVIDER:  Startwert für den Abwärtszähler
 
-Ausgänge:
+**Ausgänge:**
+
 SYNC:             1 wenn alle Zählerregister 0, sonst 0
 
 manuel.walz@advantest.com
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